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LMK5C33414ARGCT

Name: Texas Instruments LMK5C33414ARGCT
Brand: Texas Instruments
SKU: 595-LMK5C33414ARGCT
Price: 69250 CLP
Availability: InStock

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Mouser N.º:

595-LMK5C33414ARGCT

Fabricante N.º:

LMK5C33414ARGCT

Fabricante:

Texas Instruments

Descripción:

Sintetizador de reloj / depurador de fluctuación Three DPLL three AP LL four-input and 1

Hoja de datos:

LMK5C33414ARGCT Hoja de datos

Modelo ECAD:

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	$69.250	$69.250
	$57.098	$570.980
	$54.298	$1.357.450
	$50.725	$5.072.500
	$44.800	$11.200.000

.hidden-for-nojs { display: none; } .pull-right-nojs { justify-content: flex-end; }

Atributo del producto	Valor de atributo	Seleccionar atributo
Fabricante:	Texas Instruments
Categoría de producto:	Sintetizador de reloj / depurador de fluctuación
RoHS:
Número de salidas:	14 Output
Frecuencia de salida máx.:	1.25 GHz
Nivel de salida:	HSCL, HSDS/ LVPECL, LVCMOS, LVDS
Nivel de entrada:	HCSL, LVCMOS, LVDS, LVPECL, XTAL
Paquete / Cubierta:	VQFN-64
Frecuencia de entrada máxima:	200 MHz, 800 MHz
Voltaje de alimentación - Mín.:	3.135 V
Voltaje de alimentación - Máx.:	3.465 V
Temperatura de trabajo mínima:	- 40 C
Temperatura de trabajo máxima:	+ 105 C
Serie:	LMK5C33414A
Estilo de montaje:	SMD/SMT
Marca:	Texas Instruments
País de ensamblaje:	Not Available
País de difusión:	Not Available
País de origen:	PH
Sensibles a la humedad:	Yes
Corriente de suministro operativa:	850 mA, 965 mA, 1.085 A
Producto:	Clock Jitter Cleaners / Synchronizers
Tipo de producto:	Clock Synthesizers / Jitter Cleaners
Cantidad de empaque de fábrica:	250
Subcategoría:	Clock & Timer ICs
Tipo:	Network Synchronizer and Jitter Cleaner

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CNHTS:: 8542399000
CAHTS:: 8542310000
USHTS:: 8542310030
ECCN:: EAR99

LMK5C33414A High-Performance Network Synchronizer

Texas Instruments LMK5C33414A High-Performance Network Synchronizer includes a jitter cleaner designed to meet stringent wireless communications and infrastructure application requirements. The network synchronizer integrates three DPLLs to provide hitless jitter and switching attenuation with programmable loop bandwidth and no external loop filters. This feature maximizes the flexibility and ease of use of the device. Each DPLL phase locks a paired APLL to a reference input.